10.11. Adresslogik und Segmentadressierung history menue Letztmalig dran rumgefummelt: 16.06.16 19:06:49

1. Adresslogik
2. Adressrechnung
 3. Shadow-RAM und Urlader-Systeme
4. Speicherbankumschaltungen
5. Segementadressierung

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1. Adresslogik history menue scroll up

Mit diesen Schaltkreisen wird versucht, dem Leistungsverlust auf den Signalleitungen Herr zu werden und zwar fast immer in Blöcken zu jeweils 8 Bit. Oftmals auch noch mit einer Speicherstufe versehen, können Signale so statisch festgehalten und verstärkt werden. Dabei ist die Arbeitsrichtung fest.

variabler Adressdecoder
der zu adressierende Gesamtbereich (RAM oder ROM) wird über  die Freigabelogik des Decoders realisiert
die Chipauswahl realisiert das Binäreingangssystem des jeweiligen Decoders sowie eine eventuelle Zusatzlogik
die Logik, welche den RAM einschaltet, muss den ROM ausschalten und umgekehrt - dazu braucht man keine zwei Schaltungen, sondern eine negiert und eine nicht negiert
Adress-Bits, welche nicht durch die Speicherbausteine genutzt werden müssen über eine OR-Logik zusammengefasst das Freigabesignal des zugehörigen Decoders steuern
OS im RAM machen durchaus Sinn
Erstellen einer Liste der eingesetzten Speicherelemente (RAM und ROM)
die Adressräume der eingesetzten Speicherbauelemente sollte möglichst linear sein und auf Grundadressen beginnen
getrennte Chipauswahllogiken für RAM und ROM entwickeln
Adressräume festlegen
Chipauswahllogiken beginnen ab dem ersten nicht vom Speicher selbst genutzten Adressbit die restlichen Adressbits werden OR bzw. NOR + Negator verknüpft und zur Freigabe für den Decoder genutzt
folgende IS sind hierfür besonders wichtig: 
  • 4000 Zwei × 3-Eingangs-NOR + Negator
  • 4001 Vier × 2-Eingangs-NOR
  • 4002 Zwei × 4-Eingangs-NOR
  • 4025 Drei × 3-Eingangs-NOR
  • 4078 Ein × 8-Eingangs-NOR
  • 7402 Vier × 2-Eingangs-NOR
  • 7423 Zwei × 4-Eingangs-NOR
  • 7425 Zwei × 4-Eingangs-NOR mit Steuereingang
  • 7427 Drei × 4-Eingangs-NOR
  • 7432 Vier × 2-Eingangs-OR
Adressrechnung für den LC-80 mit Adressalternativen
Adressrechnung für den POLYCOMPUTER

2. Adressrechnung history menue scroll up
Mit diesen Schaltkreisen wird versucht, dem Leistungsverlust auf den Signalleitungen Herr zu werden und zwar fast immer in Blöcken zu jeweils 8 Bit. Oftmals auch noch mit einer Speicherstufe versehen, können Signale so statisch festgehalten und verstärkt werden. Dabei ist die Arbeitsrichtung fest.
Binär

Dezimal

HEX

 216 215 214 213 212 211 210 29 28 27 26 25 24 23 22 21 20 Bereich  HEX Bereich  DEZ

20

 1 00001H 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0000H - 0001H 0 - 1
21 2 00002H 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0000H - 0002H 0 - 2
22 4 00004H 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0000H - 0004H 0 - 4
23 8 00008H 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0000H - 0008H 0 - 8
24 16 00010H 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0000H - 0010H 0 - 16
25 32 00020H 0 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0000H - 0020H 0 - 32
26 64 00040H 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0000H - 0040H 0 - 64
27 128 00080H 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0000H - 0080H 0 - 128
28 256 00100H 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0000H - 0100H 0 - 256
29 512 00200H 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0000H - 0200H 0 - 512
210 1024 00400H 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0000H - 0400H 0 - 1024
211 2048 00800H 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0000H - 0800H 0 - 2048
212 4096 01000H 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0000H - 1000H 0 - 4096
213 8192 02000H 0 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0000H - 2000H 0 - 8192
214 16384 04000H 0 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0000H - 4000H 0 - 16384
215 32768 08000H 0 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0000H - 8000H 0 - 32768
216 65536 10000H 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0000H - 10000H 0 - 65536

Decodiertabelle HEX, Dezimal und Binär der ersten 64KByte für linear adressierte Prozessoren (Liste von Grundadressen)

 
diese Übersicht sind die Grundadressen zur ROM- und RAM-Decodierung
in einer neuen Gruppe wird jeweils ein Bit mehr für die Adressierung benötigt und kann als Freigabesignal für den Decoder dienen
EPROM-Liste und die Liste statischer RAM

3. Shadow-RAM und Urlader-Systeme history menue scroll up

Mit diesen Schaltkreisen wird versucht, dem Leistungsverlust auf den Signalleitungen Herr zu werden und zwar fast immer in Blöcken zu jeweils 8 Bit. Oftmals auch noch mit einer Speicherstufe versehen, können Signale so statisch festgehalten und verstärkt werden. Dabei ist die Arbeitsrichtung fest.

4. Speicherbankumschaltungen history menue scroll up

Mit diesen Schaltkreisen wird versucht, dem Leistungsverlust auf den Signalleitungen Herr zu werden und zwar fast immer in Blöcken zu jeweils 8 Bit. Oftmals auch noch mit einer Speicherstufe versehen, können Signale so statisch festgehalten und verstärkt werden. Dabei ist die Arbeitsrichtung fest.

5. Segemenatadressierung history menue scroll up
Mit diesen Schaltkreisen wird versucht, dem Leistungsverlust auf den Signalleitungen Herr zu werden und zwar fast immer in Blöcken zu jeweils 8 Bit. Oftmals auch noch mit einer Speicherstufe versehen, können Signale so statisch festgehalten und verstärkt werden. Dabei ist die Arbeitsrichtung fest.

Segementadressenberechnung

Beispiel für Rechnen mit Segment-/Offsetadressen:

1.     Beispiel

gegeben: Segment-/Offsetadresse: 3960:000Ahex

gesucht: physische Adresse           ??

Lösung: Segmentadresse um 4 Bit nach links: 39600hex

Offsetadresse           000Ahex

physische Adresse:        3960Ahex

2.     Beispiel

gegeben: Segment-/Offsetadresse: 2E40:B20Ahex

gesucht: physische Adresse           ??

Lösung: Segmentadresse um 4 Bit nach links: 2E400hex

Offsetadresse           B20Ahex

physische Adresse:                3960Ahex

 

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... dieser Text wurde nach den Regeln irgendeiner Rechtschreibreform verfasst - ich hab' irgendwann einmal beschlossen, an diesem Zirkus nicht mehr teilzunehmen ;-)

„Dieses Land braucht eine Steuerreform, dieses Land braucht eine Rentenreform - wir schreiben Schiffahrt mit drei „f“!“

Diddi Hallervorden, dt. Komiker und Kabarettist

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